Intel CM8063101049806 Datenblatt Seite 71
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- Inhaltsverzeichnis
- LESEZEICHEN
Bewertet. / 5. Basierend auf Kundenbewertungen
Intel
®
Itanium
®
Processor 9300 Series and 9500 Series Datasheet 71
Electrical Specifications
2.14 Test Access Port (TAP) Connection
The recommended TAP connectivity is detailed in the Intel
®
Itanium
®
Platform Debug
Port Design Guide (DPDG).
§
T11
RESET_N deasserted delay to SKTID[2]
deasserted (as error in)
100 ns
T12
SKTID[2] (as error in) asserted pulse width
3
SYSCLK
cycles
T13
BOOTMODE[2:0], FLASHROM_CFG[1:0] hold
after RESET_N deasserted
1us
T14
BOOTMODE[2:)], FLASHROM_CFG[1:0] setup to
RESET_N asserted
0ns
Table 2-40. RESET_N and SKTID Timing (Sheet 2 of 2)
Parameter Description MIN MAX UNIT
- Itanium 1
- Processor 9300 1
- Series and 9500 Series 1
- Contents 3
- Revision History 8
- 1 Introduction 9
- Introduction 10
- 10 Intel 10
- 12 Intel 12
- Processor 9500 Series 13
- Product Features 13
- 14 Intel 14
- 1.2 Architectural Overview 15
- 1.2.2 Intel 16
- 18 Intel 18
- Cache Sizes 20
- 1.6 Terminology 20
- 1.7 State of Data 21
- 1.8 Reference Documents 21
- 22 Intel 22
- 2 Electrical Specifications 23
- 2.2 Signal Groups 24
- REFCLK-JITTER-RMS 27
- 2.4 Intel 28
- Signaling Specifications 28
- SYSCLK-TX-VARIABILITY 29
- X-CM-PIN 29
- X-CM-RIPPLE-PIN 29
- DUTY-CYCLE-PIN 30
- X-DATA-CLK-SKEW-PIN 30
- ACC-JIT-N_UI-1E-9 30
- JITUI-UI-1E-9PIN 30
- 2.4.2 Intel 32
- Table 2-10. Intel 36
- Values for Intel 36
- 2.4.3 Intel 37
- Requirements for Intel 37
- 0.01 100 10001010.1 42
- Time Duration (us) 42
- Sustained Current (A) 42
- 2.6.3 Intel 44
- Cache Tolerances 44
- VccUNCORE Tolerance Bands 45
- VccCORE Tolerance Bands 47
- VccCACHE Tolerance Bands 48
- 2.6.4 Intel 49
- Tolerances 49
- VccUnCore Tolerance Band 50
- VccCore[1-4] Tolerance Band 51
- 1, 2, 3, 4 54
- and Intel 57
- Ararat (Sheet 1 of 2) 58
- Ararat II (Sheet 2 of 4) 60
- Ararat II (Sheet 3 of 4) 61
- Processor 9300 Series only) 62
- 2.10 Mixing Processors 64
- Electrical Specifications 65
- 66 Intel 66
- Platform Debug 71
- Port Design Guide (DPDG) 71
- 72 Intel 72
- 3 Pin Listing 73
- 10 of 32) 93
- 11 of 32) 94
- 12 of 32) 94
- 13 of 32) 95
- 14 of 32) 95
- 15 of 32) 96
- 16 of 32) 96
- 17 of 32) 97
- 18 of 32) 97
- 19 of 32) 98
- 20 of 32) 98
- 21 of 32) 99
- 22 of 32) 99
- 23 of 32) 100
- 24 of 32) 100
- 25 of 32) 101
- 26 of 32) 101
- 27 of 32) 102
- 28 of 32) 102
- 29 of 32) 103
- 30 of 32) 103
- 31 of 32) 104
- 32 of 32) 104
- Processor 9500 Series 106
- Processor 107
- 9500 Series) (Sheet 2 of 3) 107
- NO CONNECT 108
- 9500 Series) (Sheet 1 of 2) 110
- 9300 Series) (Sheet 2 of 2) 112
- Processor 9300 Series 114
- 9500 Series) (Sheet 2 of 2) 117
- Pin Listing 118
- 118 Intel 118
- 4 Mechanical Specifications 119
- Mechanical Specifications 120
- 120 Intel 120
- 4.2 Intel 121
- Processor 9300 Series 121
- Figure 4-3. Intel 122
- Figure 4-4. Intel 123
- Figure 4-5. Intel 124
- Figure 4-6. Intel 125
- Figure 4-7. Intel 126
- Figure 4-8. Intel 127
- Figure 4-9. Intel 128
- 4.7 Processor Materials 130
- 4.8 Package Markings 130
- 132 Intel 132
- 5 Thermal Specifications 133
- 5.1.2.1 Overview 135
- 5.1.2.2 Implementation 136
- 5.1.5 Thermal Warning 137
- 5.1.6 Thermal Trip 137
- 5.1.7 PROCHOT 138
- 5.1.8 FORCEPR_N Signal Pin 138
- Considerations 139
- Substrate 140
- Thermocouple 140
- Attach Point 140
- Thermal Specifications 142
- 142 Intel 142
- 6 System Management Bus 143
- 6.2 SMBus Memory Component 144
- 6.2.2 Scratch EEPROM 149
- Transactions 150
- Series Package 151
- 6.4.3.1 CPUID 152
- 6.4.3.2 Boost Core Frequency 152
- 6.4.4 Processor Uncore Data 153
- 6.4.5 Cache Data 154
- 6.4.6 Package Data 155
- 6.4.7 Part Number Data 155
- 6.4.8 Thermal Reference Data 155
- 6.4.9 Feature Data 156
- 6.4.10 Other Data 157
- 6.4.11 Checksums 157
- 158 Intel 158
- 7 Signal Definitions 159
- 168 Intel 168
- 170 Intel 170
- 172 Intel 172
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